题目内容
（请给出正确答案）
[主观题]
在VHDL中，用语句（)表示检测clock的上升沿。
A.clock’EVENT
B.clock’EVENT AND clock=’1′
C.Clok=’0′
D.clock’EVENT AND clock=’0′
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A.clock’ EVENT
B.clock’ EVENT AND clock=’1’
C.clock=’1’
D.clock’ EVENT AND clock=’0’
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第2题
在VHDL中，用语句表示检测clock的上升沿
A.clock’ EVENT
B.clock’ EVENT AND clock=’1’
C.clock=’1’
D.clock’ EVENT AND clock=’0’
第3题
在VHDL中，可以用语句（）表示检测clock下降沿。
A.clock’ event
B.clock’ event and clock=’1’
C.clock=’0’
D.clock’ event and clock=’0’
第4题
在VHDL中，可以用语句()表示检测clock下降沿。
在VHDL中，可以用语句（)表示检测clock下降沿。
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A.clockevent
B. clock event and clock="1"
C. clock=“O”
D. clock event and clocke'
第6题
在VHDL中，用语句（) 表示clock的下降沿。
A.c1ock' EVENT
B.c1ock' EVENT AND c1ock=' 1'
C.c1ock=' 0'
D.c1ock' EVENT AND clock=' 0'
第7题
在VHDL中，用语句_表示clock的下降沿
A.clock’EVENT
B.clock’EVENT AND clock=’1’
C.clock=’0’
D.clock’EVENT AND clock=’0’
第9题
在VHDL的IEEE标准库中，预定义的标准逻辑位STD_LOGIC的数据类型中是用()表示的。
在VHDL的IEEE标准库中，预定义的标准逻辑位STD_LOGIC的数据类型中是用（)表示的。
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A、小写字母和数字是数字
