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[主观题]

图10.17(a)、(b)、(c)、(d)所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的波形如图10.17(e)所示。试画

图10.17(a)、(b)、(c)、(d)所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的波形如图10.17(e)所示。试画出各触发器Q1,Q2,Q3,Q4的波形。

图10.17(a)、(b)、(c)、(d)所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的

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第1题

下图所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的波形如图(b)所示。试画出各触发器输出端Q的波形

下图所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的波形如图(b)所示。试画出各触发器输出端Q的波形。

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第2题

已知时钟脉冲CP的波形如图21.1.5(在教材中)所示,试分别画出图21-20中各触发器输出端Q的波形。设它们的初始状

已知时钟脉冲CP的波形如图21.1.5(在教材中)所示,试分别画出图21-20中各触发器输出端Q的波形。设它们的初始状态均为0。指出哪个具有计数功能。

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第3题

已知时钟脉冲CP的波形如图21.25所示,试分别画出图21.26中各触发器输出端Q的波形。设它们的初始状态均为0。指

出哪个具有计数功能。

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第4题

把二个上升沿触发的D触发器接成图(a)所示电路,试画出CP、Q0、Q1的波形图,并说明电路的功能。设初始状态为Q0=Q1

把二个上升沿触发的D触发器接成图(a)所示电路,试画出CP、Q0、Q1的波形图,并说明电路的功能。设初始状态为Q0=Q1=0,画4个时钟脉冲。

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第5题

在图13.7(a)所示电路中,已知输入端D和CP的波形如图13.7(b)所示。各触发器的初始状态均为0,求Q1和Q2的波形。

在图13.7(a)所示电路中,已知输入端D和CP的波形如图13.7(b)所示。各触发器的初始状态均为0,求Q1和Q2的波形。

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第6题

题七图(a)所示时序逻辑电路中。设各触发器的初始状态均为“0”

题七图(a)所示时序逻辑电路中。设各触发器的初始状态均为“0”

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第7题

JK触发器组成的电路如图1.14(a)所示,设触发器的初始状态为“0”。时钟CP的波形如图1.14(b)中所示,则输出Q端的

JK触发器组成的电路如图1.14(a)所示,设触发器的初始状态为“0”。时钟CP的波形如图1.14(b)中所示,则输出Q端的波形为图1.14(b)中的( )。

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第8题

已知时钟脉冲CP的波形如题图21.1.5所示,试分别画出图中各触发器输出端Q的波形。设它们的初始状态均为“0”。指

出哪个具有计数功能。

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第9题

D触发器组成的电路如图1.14(a)所示,设触发器的初始状态为“0”。时钟CP的波形如图1.14(b)所示,则输出Q端的波形

D触发器组成的电路如图1.14(a)所示,设触发器的初始状态为“0”。时钟CP的波形如图1.14(b)所示,则输出Q端的波形为图1.14(b)中的( )。

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