题目内容（请给出正确答案）

[单选题]

在VHDL语言中，下列对进程（PROCESS)语句的语句结构及语法规则的描述中，正确的是（)

A.PROCESS为- -无限循环语句;敏感信号发生更新时启动进程，执行完成后，等待下一次进程启动

B.敏感信号参数表中，应列出进程中使用的所有输入信号

C.进程由说明部分、结构体部分、和敏感信号参数表三部分组成

D.当前进程中声明的信号也可用于其他进程

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第1题

在VHDL语言中，下列对进程（PROCES)语句的语句结构及语法规则的描述中，不正确的是:（)。

A.PROCESS 为一无限循环语句

B.敏感信号发生更新时启动进程，执行完成后，等待下一次进程启动

C.当前进程中声明的变量不可用于其他进程

D.进程由说明语句部分、并行语句部分和敏感信号参数表三部分组成

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第2题

在VHDL语言中，下列对进程（PROCESS)语句的语句结构及语法规则的描述中，正确的是哪几个选项（)。

A.进程由说明部分、结构体部分、和敏感信号三部分组成

B.敏感信号参数表中，不一定要列出进程中使用的所有输入信号

C.PROCESS为一无限循环语句;敏感信号发生更新时启动进程，执行完成后，等待下一次进程启动

D.当前进程中声明的变量不可用于其他进程

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第3题

在VHDL语言中，下列对时钟边沿检测描述中，错误的是（)。

A.if c1k' event and c1k = '1' then

B.if fal1ing-edge (c1k) then

C.if c1k' event and c1k = '0' then

D.if c1k' stable and not c1k = '1' then

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第4题

在VHDL语言中，下列对时钟边沿检测描述中，错误的是

A.if clk’event and clk = ‘1’ then

B.if falling_edge(clk) then

C.if clk’event and clk = ‘0’ then

D.if clk’stable and not clk = ‘1’ then

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第5题

下列硬件描述语言中成为IEEE标准的是

A.VHDL

B.ABEL

C.System Verilog

D.System C

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第6题

2、下列硬件描述语言中成为IEEE标准的是

A.VHDL

B.ABEL

C.System Verilog

D.System C

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第7题

下列硬件描述语言中成为IEEE标准的是

A.VHDL

B.ABEL

C.System Verilog

D.System C

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第8题

下列硬件描述语言中成为IEEE标准的是

A.VHDL

B.ABEL

C.System Verilog

D.System C

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第9题

下列硬件描述语言中成为IEEE标准的是

A.VHDL

B.ABEL

C.System Verilog

D.System C

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