题目内容
（请给出正确答案）
[主观题]
采用指令流水线控制时，如果一条指令分成取指、译码、执行、访存和回写共5个阶段，假设每个阶段的时间
相等，为一个时间片，则最理想情况下执行完9条指令，需
A.14个时间片
B.13个时间片
C.9个时间片
D.5个时间片
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A.20个时间片
B.8个时间片
C.9个时间片
D.5个时间片
更多“采用指令流水线控制时，如果一条指令分成取指、译码、执行、访存…”相关的问题
第2题
设有一台RISC机,CPU采用流水线结构，只有Load和Store指令访问内存，它们占指令总数的40%.不命中
时的损失是25个时钟周期.存取数据的不命中率为2%。取指令全部命中。问:
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(1)cache采用哈佛结构.如果取指令和存取数据全部命中时的CPI是2.0,那么这台机器实际运行时的CPI是多少？(CPI为运行一条指令的周期数。)
(2)采用指令和数据合一的cache,如果不存在Load/Store指令时的CPI为2.0,那么当存在Load/Store指令时.机器实际运行时的CPI是多少？
第3题
假设有一台RISC机器，CPU采用流水线结构，cache 采用哈佛结构（即指令cache和数据cache分离），只有load和store指令可以访存，他们占指令总数的40%， 不命中时损失25个时钟周期，存取数据的不命中率为2%，取指令全部命中，假设采用的写入策略是“命中时写入cache不写主存、不命中时写入主存”。请问：如果取指令和存取数据全部命中时CPI是2.0，那么这台机器实际运行时的CPI是多少？（CPI： cycles per instruction 执行一条指令所需要的周期数）
A.2
B.2.2
C.2.5
D.3
第4题
假设有一台RISC机器，CPU采用流水线结构，cache 采用哈佛结构（即指令cache和数据cache分离），只有load和store指令可以访存，他们占指令总数的40%， 不命中时损失25个时钟周期，存取数据的不命中率为2%，取指令全部命中，假设采用的写入策略是“命中时写入cache不写主存、不命中时写入主存”。请问：如果取指令和存取数据全部命中时CPI是2.0，那么这台机器实际运行时的CPI是多少？（CPI： cycles per instruction 执行一条指令所需要的周期数）
A.2
B.2.2
C.2.5
D.3
第5题
假设有一台RISC机器，CPU采用流水线结构，cache 采用哈佛结构（即指令cache和数据cache分离），只有load和store指令可以访存，他们占指令总数的40%， 不命中时损失25个时钟周期，存取数据的不命中率为2%，取指令全部命中，假设采用的写入策略是“命中时写入cache不写主存、不命中时写入主存”。请问：如果取指令和存取数据全部命中时CPI是2.0，那么这台机器实际运行时的CPI是多少？（CPI： cycles per instruction 执行一条指令所需要的周期数）
A.2
B.2.2
C.2.5
D.3
第6题
现采用四级流水线结构分别完成一条指令的取指、指令译码和取数、运算，以及送回运算结果四个基本操
作，每步操作时间依次为60ns，100ns，50ns和70ns，该流水线的操作周期应为(53)。若有一小段程序需要用20条基本指令完成(这些指令完全适合于在流水线上执行)，则得到第一条指令结果需(54)ns，完成该段程序需(55)ns。在流水线结构的计算机中，频繁执行(56)指令时会严重影响机器的效率。当有中断请求发生时，采用不精确断点法，则将(57)。
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A．50
B．70
C．100
D．280
第7题
现采用4级流水线结构分别完成一条指令的取指、指令译码和取数、运算以及送回运算结果4个基本操作，
每步操作时间依次为60ns、100ns、50ns和70ns。该流水线的操作周期应为(1)ns。若有一小段程序需要用20条基本指令完成(这些指令完全适合于流水线上执行)，则得到的第一条指令结果需(2)ns，完成该段程序需(3)ns。
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在流水线结构的计算机中，频繁执行(4)指令时会严重影响机器的效率。当有中断请求发生时，采用不精确断点法，则将(5)。
A．50
B．70
C．100
D．280
第8题
●在下列不同结构的处理机上执行6×6的矩阵乘法C=A×B，计算所需要的最短时间。只计算乘法指令和加法
指令的执行时间，不计算取操作数、数据传送和程序控制等指令的执行时间。加法部件和乘法部件的延迟时间都是3个时钟周期，另外，加法指令和乘法指令还要经过"取指令"和"指令译码"的时钟周期，每个时钟周期为20ns，C的初始值为"0"。各操作部件的输出端有直接数据通路连接到有关操作部件的输入端，在操作部件的输出端设置有足够容量的缓冲寄存器。如果处理机内只有一个通用操作部件，采用顺序方式执行指令，那么所需要的时间为 (5) 。如果单流水线标量处理机，有一条两个功能的静态流水线，流水线每个功能段的延迟时间均为一个时钟周期，加法操作和乘法操作各经过3个功能段，那么所需要的时间为 (6) 。
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(5) A．105.6ms
B．52.8ms
C．39.6ms
D．72.8ms
(6) A．6480ns
B．3240ns
C．4020ns
D．8040ns
第9题
在下列不同结构的处理机上执行6x6的矩阵乘法C：A×B，计算所需要的最短时间。只计算乘法指令和加法指
令的执行时间，不计算取操作数、数据传送和程序控制等指令的执行时间。加法部件和乘法部件的延迟时间都是3个时钟周期，另外，加法指令和乘法指令还要经过“取指令”和“指令译码”的时钟周期，每个时钟周期为20ns，C的初始值为“0”。各操作部件的输出端有直接数据通路连接到有关操作部件的输入端，在操作部件的输出端设置有足够容量的缓冲寄存器。如果处理机内只有一个通用操作部件，采用顺序方式执行指令，那么所需要的时间为(5)。如果单流水线标量处理机，有一条两个功能的静态流水线，流水线每个功能段的延迟时间均为一个时钟周期，加法操作和乘法操作各经过3个功能段，那么所需要的时间为(6)。
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A．105.6ms
B．52.8ms
C．39.6ms
D．72.8ms
