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[主观题]

设计一个可控进制的计数器,当M=0时工作在八进制,M=1时工作在六进制。(1)只用一片同步十进制计数器74LS160及适当的门电路设计并给出设计原理及电路,74160的电路符号及功能表如图所示;(2)用JK触发器和门电路设计,要求电路最简,判断能否自启动。给出状态转换图,状态方程、驱动方程、输出方程。设计一个可控进制的计数器,当M=0时工作在八进制,M=1时工作在六进制。(1)只用一片同步十进制计数

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第1题

设计一个可控进制的计数器,当输入控制变量M=0时工作在五进制;M=1时工作在十五进制。请标出计数输入端和进位

输出端。

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第2题

试用JK触发器设计一个可控计数器,当控制信号M=0时工作在五进制,当M=1时工作在六进制。

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第3题

用四位二进制计数器74LS161设计一个可控进制的计数器,当输入控制变量M=0时工作在五进制,M=1时工作在十五进制。
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第4题

设计一个按自然态序进行计数的同步加法计数器,要求当控制信号M=0时为六进制,M=1时为十二进制。

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第5题

用两片同步十六进制计数器74HC161设计一个可控进制的计数器,当控制信号M=0时为三十进制,当M=1
时为三十一进制。请标明计数输入端和进位输出端。74HCI61的功能表和框图见表T1.6和图T1.6。

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第6题

设计一个可控进制计数器,当控制输入M=0时为七进制计数,当M=1时为十三进制计数。 (1)试用MSI

设计一个可控进制计数器,当控制输入M=0时为七进制计数,当M=1时为十三进制计数。 (1)试用MSI计数器设计该可控计数器。 (2)用VHDL语言设计该可控计数器。

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第7题

用同步十进制计数器74160设计一个可变进制计数器,要求在控制信号M=0时为五进制,而在M=1时为七进制。可以附加必要的门电路。请标明计数输入端与进位输出端。
用同步十进制计数器74160设计一个可变进制计数器,要求在控制信号M=0时为五进制,而在M=1时为七进制。可以附加必要的门电路。请标明计数输入端与进位输出端。

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第8题

用同步十六进制计数器74163设计一个可变进制计数器,要求在控制信号M=0时为十进制,而在M=1时为十二进制。可以附加必要的门电路。请标明计数输入端与进位输出端。
用同步十六进制计数器74163设计一个可变进制计数器,要求在控制信号M=0时为十进制,而在M=1时为十二进制。可以附加必要的门电路。请标明计数输入端与进位输出端。

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第9题

用同步十六进制计数器74HC161设计一个可变进制的计数器。要求在控制信号M=0时,为十二进制,在M=1
时为十进制。请标明计数输入端和进位输出端。74HC161的框图和功能表见图T2.6和表T2.6。

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第10题

用同步十六进制计数器74HC161设计一个可变进制计数器,当控制信号M=1时为十进制,而M=0时为七进
制。请标明计数输入端和进位输出端。可以附加必要的门电路。74HC161的框图和功能表如图T6.5和表T6.5。

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第11题

用VHDL设计一个可控进制的同步计数器,当控制端M=0时为10进制计数器,控制端M=1时为12进制计数器。
用VHDL设计一个可控进制的同步计数器,当控制端M=0时为10进制计数器,控制端M=1时为12进制计数器。

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