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（请给出正确答案）
[主观题]
图4.17(a)(教材图4.14(a))是一个JK触发器和一个非门组成的逻辑电路,其输人K和CP的波形如图4.17
图4.17（a)（教材图4.14（a))是一个JK触发器和一个非门组成的逻辑电路,其输人K和CP的波形如图4.17
(b)所示,试画出Q的波形图。设初始状态Q=0。
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第1题
已知图4.2(a)(教材图4. 02(a))所示逻辑电路的输人波形如图4.2(b)所示，试画出输出F的波形图。
已知图4.2（a)（教材图4. 02（a))所示逻辑电路的输人波形如图4.2（b)所示，试画出输出F的波形图。
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第2题
74LS175型四上升沿D触发器和74LS112型双下降沿JK触发器的接线图如图 21.40（a)所示，它们的外引线排列分别见
74LS175型四上升沿D触发器和74LS112型双下降沿JK触发器的接线图如图 21.40(a)所示，它们的外引线排列分别见教材图21.6.4(b)和教材图21.11(b)。(1)试按图画出逻辑电路；(2)设CP，
，D1的波形如图21.40(b)所示，试画出两触发器输出端Q的波形。两触发器的初始状态均为0。
第4题
由负边沿JK，触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1)写出电路的
由负边沿JK，触发器F1和F0组成的时序逻辑电路如图4.21（a)（教材图4.18)所示。试求:（1)写出电路的
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输出方程、驱动方程和状态方程;(2)列出A=1时的状态转换表,画出波形图(画4个CP);(3)若A=0,则电路的工作情况如何？
第5题
图题4.10是利用上升沿JK触发器CD4027构成，已知CP、R、J、K的电压波形如图所示，试画出输出端Q和端的电压波形。
图题4.10是利用上升沿JK触发器CD4027构成，已知CP、R、J、K的电压波形如图所示，试画出输出端Q和
第7题
已知一电平触发的D锁存器和一正边沿触发的D触发器的输人波形如图4.15(a)(教材图4.12)所示，试分
已知一电平触发的D锁存器和一正边沿触发的D触发器的输人波形如图4.15（a)（教材图4.12)所示，试分
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别画出输出Q的波形图。
第8题
已知时钟脉冲CP的波形如图21.1.5（在教材中)所示，试分别画出图21－20中各触发器输出端Q的波形。设它们的初始状
已知时钟脉冲CP的波形如图21.1.5(在教材中)所示，试分别画出图21-20中各触发器输出端Q的波形。设它们的初始状态均为0。指出哪个具有计数功能。
第9题
梯形图及输人波形如图10.8(教材图10.05)所示，画出PLC的Y0、Y1、Y2输出波形。
梯形图及输人波形如图10.8（教材图10.05)所示，画出PLC的Y0、Y1、Y2输出波形。
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第10题
图（a)是由D触发器和JK触发器构成的电路，图（b)是输入波形，画出输出Q1、Q2的波形。
图(a)是由D触发器和JK触发器构成的电路，图(b)是输入波形，画出输出Q1、Q2的波形。
第11题
画出图P5.8(a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波形如
画出图P5.8（a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波形如
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图P5.8(b)所示。设触发器的初始状态为Q=0。
