题目内容
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[主观题]
试用下降沿触发的D触发器设计一同步时序电路，其状态图如图题6.3.4（a)所示，S0、S1、S2⌘
试用下降沿触发的D触发器设计一同步时序电路，其状态图如图题6.3.4(a)所示，S0、S1、S2的编码如图题6.3.4(b)所示。
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试用下降沿触发的D触发器设计一同步时序电路，其状态图如下图(a)所示，S0、S1、S2的编码如下图(b)所示。
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第3题
试用下降沿出发的D触发器设计一同步时序电路，状态图如6.3.4(a)，S0，S1，S2的编码如6
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.3.4(a)。
第7题
如图中上升沿触发的D触发器和下降沿触发的JK触发器的CP、D、波形如图所示，试画出Q的波形。
如图中上升沿触发的D触发器和下降沿触发的JK触发器的CP、D波形如图所示，试画出Q的波形。
