题目内容 (请给出正确答案)
[单选题]

对由JK触发器组成的异步加法计数器来讲,脉冲信号只与其()的脉冲端子相连、各触发器的数据输入端应()。

A.最高位触发器,悬空

B.最高位触发器,接地

C.最低位触发器,悬空

D.最低位触发器,接地

答案
最低位触发器,悬空
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第1题

脉冲异步时序逻辑电路的存储电路由()组成,电路输入信号为()。

A.触发器;脉冲信号

B.延迟元件;电平信号

C.触发器;电平信号

D.延迟元件;脉冲信号

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第2题

在脉冲异步时序逻辑电路中,将所有使用的由下降沿触发的钟控触发器改为同种类的上升沿触发的钟控触发器,对电路的功能没有影响。
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第3题

构造一个十进制的异步加法计数器,需要()个触发器。

A.2

B.3

C.4

D.10

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第4题

对于脉冲异步时序逻辑电路,下列说法正确的是()。

A.对输入信号没有约束

B.不允许两个或两个以上的输入端同时出现脉冲

C.不允许两个或两个以上的输入端同时发生变换

D.都不正确

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第5题

脉冲异步时序电路的输入信号应该是 ()。

A.电平信号

B.模拟信号

C.脉冲信号

D.中规模信号

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第6题

异步电平时序逻辑电路的存储电路一般是由触发器组成的。
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第7题

脉冲异步时序逻辑电路的输出信号一定是脉冲信号。
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第8题

某脉冲异步时序逻辑电路有4个输入信号,下列输入()是无效输入。

A.1001

B.1000

C.0001

D.0100

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第9题

在同步时序逻辑电路中,将所有使用的由下降沿触发的钟控触发器改为同种类的上升沿触发的钟控触发器,对电路的功能没有影响。
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第10题

3、下列关于 INT0的描述中______是正确的。

A.中断触发信号由单片机的 P3.0引脚输入

B.中断触发方式选择位 ET0可以实现电平触发方式或脉冲触发方式的选择

C.在电平触发时,高电平可引发 IE0自动置位,CPU响应中断后 IE0可自动清零

D.在脉冲触发时,下降沿引发 IE0自动置位,CPU响应中断后 IE0可自动清零

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