题目内容 (请给出正确答案)
[单选题]

下列哪个流程是基于EDA软件的FPGA / CPLD一般设计流程()。

A.设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载

B.逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载

C.逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载

D.逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载

答案
综合可理解为,将软件描述与给定的硬件结构用电路网表示的映射过程,并且这种映射关系是唯一的(即综合结果是唯一的)
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第1题

将RTL代码转为网表是哪个阶段? 布局布线阶段的需要输入的设计文件是代码还是网表? 功能验证阶段通常有哪些EDA工具? Synopsys、Cadence两家的仿真验证工具、逻辑综合工具、形式验证工具、布局布线工具分别是什么?
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第2题

对设计电路的逻辑功能进行验证被称为()。

A.功能仿真

B.时序仿真

C.编程验证

D.逻辑综合

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第3题

Quartus II软件把逻辑综合、布局布线等软件集成在一起,称为()工具。

A.编辑

B.综合

C.编译

D.编程

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第4题

功能仿真与具体所用芯片相关,是布局布线后的仿真。
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第5题

功能仿真主要用来验证设计电路的逻辑功能是否达到预期。
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第6题

(2) ISIS模块的主要功能是 ______。

A.电路原理图设计与仿真

B.高级布线和编辑

C.图像处理

D.C51源程序调试

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第7题

(2) ISIS模块的主要功能是 ______。

A.电路原理图设计与仿真

B.高级布线和编辑

C.图像处理

D.C51源程序调试

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第8题

以下属于产品定义阶段工作内容的是()

A.用户研究

B.流程设计

C.原型设计

D.产品上线

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第9题

现代电子产品开发流程引入仿真环节后,增加了开发的成本。
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第10题

器件编程指()。

A.以原理图或HDL方式描述设计电路。

B.对设计文件逻辑化简优化,用目标芯片中的逻辑单元来实现设计逻辑。

C.对设计电路的逻辑功能进行验证。

D.把生成的编程文件装入可编程逻辑器件中。

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