题目内容（请给出正确答案）

[单选题]

对于TMS320F28027描述正确的是（）。

A.ePWM模块的时钟来自SYSCLKOUT，可设置分频，分频系数1-256

B.ePWM模块分辨率是24位

C.F28027有4组ePWM模块，每组有2个独立的PWM输出引脚，分别为PWMxA和PWMxB

D.可产生对称PWM，但不能产生非对称PWM

答案

以上都是

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第1题

在以下分频器程序中，系统频率clk50m为50MHz则：分频得到的时钟频率为多少？分频得到的时钟占空比为多少？； always@（posedge clk50m) begin if （count8==7) begin count8<=0; clk_6mhz<=1; end else begin count8<=count8+1; clk_6mhz<=0; end end

A.7.15MHz 1/8

B.6.25MHz 1/4

C.6.25MHz 1/8

D.7.15MHz 1/4

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第2题

利用计数器将50M的系统时钟分频要得到4Hz的信号，则计数器的最大值应为（）

A.6250001

B.6249999

C.6250000

D.以上都不对

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第3题

3.2MHz的脉冲信号经一级8分频后输出为（）kHz .

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第4题

2PSK信号在接收端因为载波同步系统中的分频，可能产生载波相位状态转移，发生对信号的错误解调。

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第5题

在由双向移位寄存器74LS194组成的扭环形计数器中，若4位（1~4）移位寄存器的第3个输出端通过非门加到串行数码输入端上，则可构成（)分频电路。

A.5

B.6

C.9

D.16

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第6题

某同学设计的VHDL部分源码如下，试问下述描述正确的是【b 】 P1:process （clk_in) variable cnt: natural range 0 to 19; begin if rising_edge（clk_in) then if cnt=div_num then cnt:=0; elsif cnt<=div_num/2 then clk_out<='0'; cnt:=cnt+1; else clk_out<='1'; cnt:=cnt+1; end if; end if; end process P1;

A.以上都不准确

B.实现10分频功能

C.div_num在port内定义为in

D.rising_edge(clk_in)表示下边沿

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第7题

下面关于KL25的ADC模块描述正确的有:

A.ADC模块只有一个，是线性逐次逼近ADC。

B.同时具有差分输入和单端输入两种采集模式。

C.差分模式的精度可配置为24位。

D.单端模式的精度可配置为24位。

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第8题

turtle模块中设置画笔颜色的方法是 turtle.（）

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第9题

若写时钟50MHz，读时钟40MHz，如果不丢失地将10万个数据送入读时钟域下游节点，则FIFO深度应设置为多少？

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第10题

下述描述正确的是

A.=b+c；说明是变量赋值可以在process外

B.a<=b+c；说明是信号赋值只能在process外

C.有时钟信号clk，则clk’event AND clk=’1’表示时钟的上升沿

D.上述都不准确

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