题目内容
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[主观题]
Verilgo程序编写设计流程中的第一步：HDL文本输入
答案
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A.标杆瞄准
B.找出核心流程
C.流程设计
D.检验新流程
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第3题
输入一个数字，输出其质因式分解 例如： 输入12，输出：12 = 2 * 2 * 3 输入98，输出：98 = 2 * 7 * 7 输出23，输出：23 = 23 在文本中说明，该程序的设计的思路，以及该程序最容易发生错误的地方在哪里？你是如何避免的（5分！）？
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第6题
下列哪个流程是正确的基于EDA软件的FPGA / CPLD设计流程（）。
A.设计输入→分析综合→功能仿真→编程下载→硬件测试
B.设计输入→功能仿真→分析综合→编程下载→硬件测试；
C.设计输入→功能仿真→分析综合→编程下载→硬件测试；
D.原理图输入→功能仿真→适配→编程下载→综合→硬件测试
第7题
如果要采用原理图描述的方式进行设计输入，应创建（）文件。
A.Block Diagram/Schematic File
B.State Machine File
C.Verilog HDL File
D.VHDL File
第8题
下列哪个流程是基于EDA软件的FPGA / CPLD一般设计流程（）。
A.设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载
B.逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载
C.逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载
D.逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载
