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驱动方程是触发器输入信号的逻辑函数式()。

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第1题

边沿触发器的次态仅取决于CP信号的边沿到达时输入的逻辑状态,而在这时刻之前或以后,输入信号的变化对触发器输出的状态没有影响。
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第2题

SR触发器输入信号的约束条件为S+R=0。
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第3题

脉冲异步时序逻辑电路的存储电路由()组成,电路输入信号为()。

A.触发器;脉冲信号

B.延迟元件;电平信号

C.触发器;电平信号

D.延迟元件;脉冲信号

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第4题

在时钟CP有效的情况下, 触发器输出的新状态等于输入信号的是 触发器。

A.D

B.JK

C.RS

D.T

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第5题

计数脉冲同时加到所有触发器的时钟信号输入端,使应翻转的触发器同时翻转的计数器,称为
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第6题

描述触发器逻辑功能的方式包括 。

A.特性表

B.特征方程

C.状态转换图

D.时序图

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第7题

下列关于查找表LUT的说法正确的是()。

A.LUT本质就是一个RAM,保存了逻辑电路的所有可能结果。

B.一个4输入的查找表包含8个存储单元。

C.查找表是FPGA实现逻辑函数的基本逻辑单元,由若干个存储单元和数据选择器构成。

D.数据选择器和触发器,只能实现组合逻辑的功能。

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第8题

触发器逻辑功能的描述方式有:()。

A.电路结构图和状态表

B.波形图

C.特征方程

D.以上都正确

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第9题

组合逻辑电路的输出是全部输入的逻辑函数。
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第10题

对由JK触发器组成的异步加法计数器来讲,脉冲信号只与其()的脉冲端子相连、各触发器的数据输入端应()。

A.最高位触发器,悬空

B.最高位触发器,接地

C.最低位触发器,悬空

D.最低位触发器,接地

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