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[主观题]

如果在时钟脉冲CP =1期间,由于干扰的原因,使触发器的数据输入信号经常有变化,此时不能选用TTL主从型结构的触发器,而应该选用边沿型或维持阻塞结构的触发器。对吗?

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第1题

在下列触发器中,输入没有约束条件的是()。

A.时钟R-S触发器

B.基本R-S触发器

C.主从J-K触发器

D.维持阻塞D触发器

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第2题

指出下列哪种电路结构的触发器可以构成移位寄存器,哪些不能构成移位寄存器。如果能够,请在()内画√,否则画×。 (A)RS锁存器() (B)同步RS触发器() (C)主从JK触发器() (D)维持阻塞触发器() (E)用CMOS传输门组成的边沿触发器()

A.×、√、√、√、×

B.×、√、×、√、√

C.×、√、√、×、√

D.√、√、√、√

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第3题

对由JK触发器组成的异步加法计数器来讲,脉冲信号只与其()的脉冲端子相连、各触发器的数据输入端应()。

A.最高位触发器,悬空

B.最高位触发器,接地

C.最低位触发器,悬空

D.最低位触发器,接地

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第4题

以下表述中,错误的是()。

A.TTL逻辑门输入高电平和输出高电平的典型值都是3.6V。

B.TTL逻辑门输出低电平时,称逻辑门处于开门状态,又称导通状态。

C.TTL非门的关门电平uOFF指此时允许输入的低电平的最大值。

D.TTL非门的开门电平uON指此时允许输入的低电平的最大值。

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第5题

SR触发器输入信号的约束条件为S+R=0。
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第6题

主从触发器中,从触发器的状态取决于主触发器,保持主从状态一致。
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第7题

脉冲异步时序逻辑电路的存储电路由()组成,电路输入信号为()。

A.触发器;脉冲信号

B.延迟元件;电平信号

C.触发器;电平信号

D.延迟元件;脉冲信号

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第8题

PLC输入电路中设有(),以防止输入触点抖动或外部干扰脉冲引起错误的输入信号。

A.RL滤波电路

B.RC滤波电路

C.Л型滤波电路

D.Г型滤波电路

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第9题

没有空翻现象的触发器有 。

A.主从RS触发器

B.维持阻塞RS触发器

C.维持阻塞D触发器

D.传输延迟JK边沿触发器

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第10题

下面关于mealy型和moore型同步时序逻辑电路描述正确的有()。

A.mealy型电路与moore型电路的主要区别在于mealy型电路的输出只与当前状态相关,而moore型电路的输出与当前输入和状态相关。

B.mealy型电路比moore型电路简单,因为moore型电路一般比mealy型电路多一个状态。

C.mealy型电路比moore型电路灵敏,因为mealy型电路的输入一旦改变,输出就可能改变,而moore型电路的输出需要时钟脉冲使触发器状态改变后才能够改变。

D.moore型电路比mealy型电路稳定,因为moore型电路的输出至少保持一个时钟周期,而mealy型电路在一个时钟周期内可能多次改变。

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