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[主观题]

维持阻塞D触发器是时钟的上升沿触发的。

答案

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第1题

4、上升沿触发异步时序逻辑电路若它的时钟脉冲上升沿未到来时，各触发器（）。

A.只能维持现态不变

B.只能维持次态不变

C.状态不定

D.状态翻转

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第2题

维持阻塞D触发器在时钟脉冲CP上升沿到来前D=1而在CP上升沿以后D变为0，则触发器状态为（）

A.0状态

B.1状态

C.状态不变

D.状态不定

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第3题

维持阻塞D触发器在时钟脉冲CP上升沿到来前D=1，而在CP上升沿以后D变为0，则触发器状态为（）。

A.0状态

B.1状态

C.状态不变

D.状态不定

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第4题

不能组成计数器的触发器为（）。

A.时钟R-S触发器

B.主从D触发器

C.维持阻塞D触发器

D.集成式J-K触发器

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第5题

在下列触发器中，输入没有约束条件的是（）。

A.时钟R-S触发器

B.基本R-S触发器

C.主从J-K触发器

D.维持阻塞D触发器

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第6题

边沿控制触发的触发器的触发方式为（）。

A.上升沿触发

B.下降沿触发

C.可以是上升沿触发，也可以是下降沿触发

D.可以是高电平触发，也可以是低电平触发

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第7题

维持阻塞RS触发器利用 , 在时钟CP的边沿传递数据, 传输延迟D触发器利用 , 在时钟CP的边沿传递数据。（A）门的延时（B）维持阻塞线（C）脉冲的低电平（D）高电平或低电平

A.B、C

B.A

C.A

D.D

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第8题

当时钟输入为低电平时，下降沿触发的触发器处于（）状态。

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第9题

主从型JK触发器是在时钟脉冲CP上升沿触发的。

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