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计数器由存储电路和触发器两部分组成。

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第1题

时序逻辑电路结构上由组合电路和存储电路两部分组成，通过反馈回路将两部分连成一个整体。

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第2题

异步电平时序逻辑电路的存储电路一般是由触发器组成的。

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第3题

在同步时序逻辑电路中，电路状态是由任意触发器组成的存储电路来保存的。

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第4题

为了记忆电路的状态，组合电路必须包含存储电路，存储电路通常以触发器为基本单元电路组成。

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第5题

由4个触发器组成的计数器一定是16进制的。

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第6题

组合逻辑电路是由（）构成。

A.门电路

B.触发器

C.门电路和触发器

D.计数器

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第7题

脉冲异步时序逻辑电路的存储电路由（）组成，电路输入信号为（）。

A.触发器；脉冲信号

B.延迟元件；电平信号

C.触发器；电平信号

D.延迟元件；脉冲信号

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第8题

对由JK触发器组成的异步加法计数器来讲，脉冲信号只与其（）的脉冲端子相连、各触发器的数据输入端应（）。

A.最高位触发器，悬空

B.最高位触发器，接地

C.最低位触发器，悬空

D.最低位触发器，接地

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第9题

能够存储的基本单元电路称为触发器。

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第10题

十进制计数器至少需要（）个触发器组成。

A.2

B.3

C.4

D.5

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